要與台積電一較高下!Intel 18A更多細節來了_風聞
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本文由半導體產業縱橫(ID:ICVIEWS)綜合
英特爾、台積電、三星激戰2nm。
目前,英特爾各部門的表現普遍不佳,但展望未來,晶圓帶服務(IFS)似乎有可能扭轉公司的局面。在前執行長Pat Gelsinger 的領導下,英特爾在晶圓代工部門方面積極投資與發展,這最終導致英特爾在某種程度上必須與供應鏈進行垂直合作。
雖然,過去的事情並不順利,但未來似乎出現曙光,這是因為英特爾的Intel 18A 節點製程即將到來。這項製程技術在2025 年VLSI 研討會上進行發表,並且英特爾公佈了令人印象深刻的成果。
英特爾一開始就透露,Intel 18A 製程技術通過整合PowerVia、BSPDN 等技術,相較於上一代的intel 3,密度提升超過30%。在PPA 比較中,Intel 18A 在標準Arm 核心架構的芯片上,1.1V 的電壓達成了25% 的速度提升和36% 的能耗降低。除此之外,Intel 18A 的面積利用率比Intel 3 更高,這代表着該製程可以達成更好的面積效率,並具有更高密度設計的潛力。
有趣的是,英特爾還展出電壓下降圖,描繪了高性能條件下節點的穩定性,並且由於Intel 18A 的PowerVia 背後供電技術,使得電壓下降能夠提供更穩定的電力傳輸。而為了支援Intel 18A 的性能,該文件還附上了一個單元比較。該比較顯示,通過PowerVia 背後供電技術,英特爾達成了更緊密的單元封裝,並提高了面積效率,這僅是因為通過被橫供電技術的導入,使得其在正面佈線中釋放了更多的空間。
因此,從這個角度來看,英特爾的Intel 18A 製程是迄今為止代工廠最強大的節點製程,隨着良率的提高,市場上的確希望看到有決定性的結果。與同業相較,Intel 18A 製程的SRAM 密度與台積電的N2 製程相當,這代表着該公司在節點優勢方面已成功與台積電相當的競爭優勢。
市場預計,將從Panther Lake SoC 和Xeon 的Clearwater Forest CPU 開始,看到Intel 18A 的實際應用。就外部產品流程整合而言,如果英特爾能夠達成良率和量產目標,我們最早可以在2026 年看到終端產品的出現。
台積電未來約30%的2nm及以下產能將位於美國
台積電在2025 年一季度財報法人説明會上宣佈,待美國子公司 TSMC Arizona 的六座晶圓廠完工後,該企業未來約 30% 的 2nm 及以下先進製程產能將位於亞利桑那州。
台積電董事長暨總裁魏哲家表示,2nm 將成為 TSMC Arizona 的主要節點。除此前已確認將導入 N2 和 A16 工藝技術的 Fab 3 外,第二階段第一座晶圓廠 Fab 4 也將支持 N2 和 A16;而未來的 Fab 5 和 Fab 6 則瞄準更先進的技術,具體情況將視客户需求決定。
據悉,iPhone 18系列將採用2nm工藝打造的A20系列處理器,新工藝可以帶來明顯的性能與能效提升,但該工藝的代工費用也更高。
在3nm工藝節點上,台積電將代工費用提高了20%,這就已經讓業界高呼價格太高,導致採用該工藝的芯片價格大漲。2nm工藝的成本只會更高,而面對這些額外的成本,蘋果大概率就是直接轉嫁到消費者身上。
對於 TSMC Arizona 的研發設施,台積電表示該主要研發中心員工總數將達到約 1000 人(約為本部的十分之一),首要目標是為當地晶圓廠提供獨立運營所需的支持,未來有望擴展到更豐富的領域。
三星2nm工藝良品率持續提升,目前已超過40%
此前有報道稱,三星在2nm(SF2)工藝的測試生產中實現了高於預期的初始良品率,達到30%以上。三星計劃在2025年第四季度量產2nm工藝,為Exynos 2600的大規模生產做好準備。
據TECHPOWERUP報道,近日三星2nm工藝開發團隊取得了令人滿意的實驗性生產里程碑,開發當中的2nm工藝在良品率方面的表現比之前的3nm工藝要更好,2nm工藝的良品率已經提升到40%以上。按照目前的推進速度,有可能剛好趕上Exynos 2600的量產。
雖然三星在2nm工藝上有了不錯的進展,但是這種表現並不足夠令人滿意。競爭對手台積電(TSMC)在去年12月對2nm工藝的試產當中,良品率就已超過60%,傳聞現在已提升至70%至80%,接近於量產的水平。
SF2集成了三星第三代GAA(Gate-All-Around)架構晶體管技術,相比於SF3(3nm),性能提高了12%,功率效率提高了25%,芯片面積減少了5%。三星還打算在2nm製程節點上引入“BSPDN(背面供電網絡)”技術,將電源軌置於晶圓的背面,以消除電源線和信號線之間的瓶頸,解決FSPDN(前端供電網絡)造成的前端佈線堵塞問題,進一步提升性能和能效,並縮小芯片面積。
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